Оперативная память. 
Оперативная память

В лекции рассказывается о микросхемах оперативной памяти, алгоритмах их работы, параметрах, типовых схемах включения, а также о способах реализации на их основе некоторых часто встречающихся функций.

Основное отличие оперативной памяти (RAM) от постоянной (ROM) состоит в возможности оперативного изменения содержимого всех ячеек памяти с помощью дополнительного управляющего сигнала записи WR. Каждая ячейка оперативной (статической) памяти представляет собой, по сути, регистр из триггерных ячеек, в который может быть записана информация и из которого можно информацию читать. Выбор того или иного регистра (той или иной ячейки памяти) производится с помощью кода адреса памяти. Поэтому при выключении питания вся информация из оперативной памяти пропадает (стирается), а при включении питания информация в оперативной памяти может быть произвольной.

Отметим, что существует также еще одна разновидность оперативной памяти, так называемая динамическая (в отличие от статической), в которой информация хранится не в регистрах (не в триггерных ячейках), а в виде заряда на конденсаторах. Эта память отличается более низкой стоимостью, меньшим быстродействием и необходимостью регулярной регенерации («Refresh» — «освежение») информации в ней (так как конденсаторы со временем разряжаются). Область применения динамической памяти гораздо уже, чем статической, в основном она используется в качестве системной оперативной памяти компьютеров, где соображения стоимости выходят на первый план. Поэтому здесь мы о ней говорить не будем, хотя многие особенности использования статической памяти относятся и к динамической памяти.

Во всех рассмотренных в предыдущем разделе схемах постоянная память в принципе может быть заменена оперативной, только карту прошивки в данном случае придется записывать в память каждый раз заново после включения питания. Аналогично, многое из сказанного в данном разделе про оперативную память справедливо и для постоянной памяти, но только информацию в постоянной памяти менять невозможно. Однако существуют также и специфические области применения оперативной памяти, которым и будет уделено здесь особое внимание.

Некоторые простейшие примеры микросхем памяти обоих этих видов приведены на рис. 12.1. Выходы данных микросхем памяти имеют тип ОК (довольно редко) или 3С. Управляющие сигналы — это сигнал выбора микросхемы CS (иногда их несколько), сигнал записи WR (обычно отрицательный) и иногда сигнал разрешения выхода OE.

Микросхема оперативной памяти К 155РУ 7 (аналог — F9342APC) имеет организацию 1Кх 1 и раздельные входной и выходной сигналы данных. Выход микросхемы — типа 3С. Управление работой микросхемы производится двумя управляющими сигналами CS и WR. Режимы работы микросхемы приведены в табл. 12.1.

Микросхема КМ 132РУ 10 отличается от К 155РУ 7 в основном большим объемом (организация 64К х 1) и несколько меньшим быстродействием. Назначение управляющих сигналов и таблица режимов работы у этих микросхем совпадают.

Микросхема КР 541РУ 2 (аналог — IM7147L-3) относится к другой разновидности микросхем памяти. У нее четыре двунаправленных вывода данных типа 3С. Управляющие сигналы те же самые: -CS иWR. Таблица режимов работы (табл. 12.2) также похожа на таблицу для одноразрядных микросхем. Главное отличие состоит в том, что в режиме записи на входах/выходах данных присутствует записываемая информация.

Микросхема HM62256 фирмы Hitachi отличается от КР 541РУ 2 прежде всего организацией (32К х 8) и управляющими сигналами (добавлен сигнал разрешения выходаOE). Когда этот сигнал пассивен (равен единице), входы/выходы данных микросхемы находятся в состоянии 3С независимо от режима работы.

Введение

дополнительного сигнала позволяет более гибко управлять работой микросхемы. К тому же обычно в подобных микросхемах при пассивном сигналеCS (равном единице) значительно уменьшается потребляемая мощность.

В настоящее время имеется огромный выбор микросхем памяти с разным объемом (от нескольких байт до нескольких мегабайт), с разным количеством разрядов (обычно 1, 4, 8, 16 разрядов), с разными методами управления, с разным потреблением и быстродействием. В каждом конкретном случае надо подбирать оптимальную память, в наибольшей степени удовлетворяющую требованиям решаемой задачи.

Таблицы режимов работы (таблицы истинности) микросхем памяти не дают достаточно информации для их практического использования. Для микросхем памяти очень важны временные параметры (задержки сигналов относительно друг друга) и порядок выставления и снятия сигналов адреса, данных и управления. Всю эту информацию дают временные диаграммы циклов записи в память и чтения (считывания) из памяти, приводимые в справочниках. Самые главные временные параметры оперативной памяти следующие:

• · время выборки адреса (задержка между изменением адреса и выдачей данных);
• · время выборки микросхемы (задержка выдачи данных по выставлению сигналаCS);
• · минимальная длительность сигнала записиWR;
• · минимальная длительность сигналаCS.

Всего же количество временных параметров может достигать двух-трех десятков, но мы не будем подробно останавливаться на этом, так как вся подобная информация имеется в многочисленных справочниках. Характерные величины всех временных параметров памяти составляет от единиц и даже долей наносекунд до десятков наносекунд.

Типичные временные диаграммы циклов записи и чтения приведены на рис. 12.2. Конкретные временные диаграммы для каждого типа памяти необходимо смотреть в справочниках.

Рис. 12.2. Типичные временные диаграммы записи в память (а) и чтения из памяти (б) Для записи информации в память надо выставить код адреса на адресных входах, выставить код записываемых в этот адрес данных на входах данных, подать сигнал записиWR и подать сигнал выбора микросхемыCS. Порядок выставления сигналов бывает различным, он может быть существенным или несущественным (например, можно выставлять или сниматьCS раньше или позже выставления или снятияWR). Собственно запись обычно производится сигналомWR илиCS, причем данные должны удерживаться в течение всего сигналаWR (илиCS) и заданное время после его окончания.

СигналCS у некоторых микросхем памяти допускается держать активным (нулевым) для всех записываемых адресов и при этом подавать импульсыWR для каждого адреса. Точно так же у некоторых микросхем допускается держать активным (нулевым) сигнал записиWR, но при этом подавать импульсыCS.

В случае микросхем памяти с двунаправленной шиной данных необходимо использовать источник записываемых данных с выходом 3С или ОК, чтобы избежать конфликта данных, записываемых в память, с данными, выдаваемыми из памяти в режиме чтения.

Для чтения информации из памяти надо выставить код адреса читаемой ячейки и подать сигналыCS иOE (если он имеется). СигналWR в процессе чтения должен оставаться пассивным (равным единице). В некоторых микросхемах памяти (называемых нетактируемыми, например, К 155РУ 7, КР 541РУ 2, HM62256) можно держать активным (нулевым) сигналCS для всех читаемых адресов. В других микросхемах (называемых тактируемыми, например, КМ 132РУ 10, К 537РУ 8) необходимо подавать свой импульсCS для каждого читаемого адреса. Понятно, что нетактируемые микросхемы гораздо удобнее в применении, чем тактируемые.

Рис. 12.3. Объединение микросхем памяти для увеличения разрядности шины данных Микросхемы оперативной памяти довольно часто объединяются для увеличения разрядности данных или разрядности адреса.

На рис. 12.3 показано объединение четырех микросхем К 155РУ 7 для получения памяти с организацией 1Кх 4. Точно так же могут быть объединены и микросхемы с двунаправленной шиной данных. К примеру, из четырех микросхем памяти с организацией 1Кх 4 можно получить память с организацией 1Кх 112.

Для увеличения количества адресных разрядов используются те же методы, что и в случае ПЗУ (см. рис. 12.3). Если объединяются всего две микросхемы памяти, то можно обойтись без применения дешифраторов, выбирающих одну из объединяемых микросхем.

Рис. 12.4. Объединение микросхем памяти для увеличения разрядности шины адреса На рис. 12.4 показан вариант схемы объединения двух микросхем HM62256 для получения памяти с организацией 64Кх 8. Дополнительный старший адресный разряд управляет прохождением сигналаCS на одну из микросхем (при нулевом уровне на дополнительном адресном разряде сигналCS проходит на левую по рисунку микросхему, при единичном уровне — на правую по рисунку микросхему). оперативный память микросхема Интересной особенностью микросхем оперативной памяти является возможность произвольного изменения порядка сигналов адресных разрядов без всяких последствий для функционирования памяти. Например, сигнал, поступающий на разряд, А 0, можно с тем же успехом подавать на, А 7, сигнал, приходящий на, А 7, подавать на, А 3, сигнал, приходящий на, А 3, подавать на, А 10 и т. д. Дело в том, что информация в оперативную память записывается по тем же самым адресам, по которым потом и читается, и перестановка адресных разрядов изменяет только номер ячейки, в которую записывается информация и из которой затем читается эта же информация. Такая взаимозаменяемость адресных входов оперативной памяти бывает полезной при проектировании разводки печатных плат. В случае ПЗУ это правило не работает, так как там информация записана раз и навсегда, и читать ее надо по тем же адресам, по которым ее ранее записали.